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GS82582DT38GE-550

Name: GSI Technology GS82582DT38GE-550
Brand: GSI Technology
SKU: 464-GS82582DT38GE550
Price: 573.33 USD
Availability: InStock

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Mouser N.º:

464-GS82582DT38GE550

Fabricante N.º:

GS82582DT38GE-550

Fabricante:

GSI Technology

Descripción:

Tamaño de memoria RAM (SRAM) 1.5/1.8V 8M x 36 288M

Hoja de datos:

GS82582DT38GE-550 Hoja de datos (PDF)

Modelo ECAD:

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Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	GSI Technology
Categoría de producto:	Tamaño de memoria RAM (SRAM)
RoHS:
Tamaño de memoria:	288 Mbit
Organización:	8 M x 36
Tiempo de acceso:	450 ps
Frecuencia de reloj máxima:	550 MHz
Tipo de interfaz:	Parallel
Voltaje de alimentación - Máx.:	1.9 V
Voltaje de alimentación - Mín.:	1.7 V
Corriente de suministro - Máx.:	1.3 A
Temperatura de trabajo mínima:	0 C
Temperatura de trabajo máxima:	+ 70 C
Estilo de montaje:	SMD/SMT
Paquete / Cubierta:	BGA-165
Empaquetado:	Tray
Marca:	GSI Technology
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	TW
Tipo de memoria:	QDR-II
Sensibles a la humedad:	Yes
Tipo de producto:	SRAM
Serie:	GS82582DT38GE
Cantidad de empaque de fábrica:	10
Subcategoría:	Memory & Data Storage
Nombre comercial:	SigmaQuad-II+
Tipo:	SigmaQuad-II+

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CNHTS:: 8542329000
CAHTS:: 8542320041
USHTS:: 8542320041
JPHTS:: 854232029
KRHTS:: 8542321020
TARIC:: 8542324500
MXHTS:: 8542320201
ECCN:: 3A991.b.2.b

SigmaQuad-II+ SRAMs

GSI Technology SigmaQuad-II+ SRAMs have built-in compliance with the SigmaQuad-II+ SRAM pinout standard for Separate I/O synchronous SRAMs. The SigmaQuad-II+ are 301,989,888-bit (288Mb) SRAMs. The SigmaQuad-II+ SRAMs are just one element in a family of low power, low voltage HSTL I/O SRAMs designed to operate at the speeds needed to implement economical high performance networking systems.

Quad SRAMs

GSI Technology Quad SRAMs combine capacity and performance with the ability to transfer four beats of data (two beats per data bus) in a single clock cycle. SigmaQuad SRAMs are synchronous memories with separate read and write data buses with unequaled transaction rates by competitors.