A3T2GF40CBF-JRL

Zentel Japan
155-A3T2GF40CBF-JRL
A3T2GF40CBF-JRL

Fabricante:

Descripción:
DRAM DDR3L 2Gb, 128Mx16, 2133 at CL14, 1.35V, FBGA-96

Modelo ECAD:
Descargue Library Loader gratis para convertir este archivo para su herramienta ECAD. Conozca más sobre el modelo ECAD.

Disponibilidad

Existencias:
No en existencias
Plazo de entrega de fábrica:
24 Semanas Tiempo estimado de producción de fábrica.
Mínimo: 2090   Múltiples: 2090
Precio unitario:
$-.--
Precio ext.:
$-.--
Est. Tarifa:

Precio (USD)

Cantidad Precio unitario
Precio ext.
$6.29 $13,146.10

Atributo del producto Valor de atributo Seleccionar atributo
Zentel Japan
Categoría de producto: DRAM
RoHS:  
SDRAM - DDR3L
2 Gbit
16 bit
1.066 GHz
FPGA-96
128 M x 16
1.283 V
1.45 V
0 C
+ 95 C
DDR3L
Tray
Marca: Zentel Japan
País de ensamblaje: Not Available
País de difusión: Not Available
País de origen: TW
Sensibles a la humedad: Yes
Estilo de montaje: SMD/SMT
Tipo de producto: DRAM
Cantidad de empaque de fábrica: 2090
Subcategoría: Memory & Data Storage
Corriente de suministro - Máx.: 85 mA
Nombre comercial: Zentel Japan
Peso de la unidad: 234.800 mg
Productos encontrados:
Para mostrar productos similares, seleccione al menos una casilla de verificación
Seleccione al menos una de las casillas de verificación anteriores para mostrar productos similares en esta categoría.
Atributos seleccionados: 0

USHTS:
8542320036
ECCN:
EAR99

DDR3 SDRAM

Zentel DDR3 SDRAM features a high-speed data transfer that is realized by the 8 bits prefetch pipelined architecture. The SDRAM has a double-data-rate architecture with two data transfers per clock cycle. They have a bi-directional differential data strobe (DQS and /DQS) and are transmitted/received with data for capturing data at the receiver. DQS is edge-aligned with data for READs; center-aligned with data for WRITEs. The differential clock inputs (CK and /CK) DLL aligns DQ and DQS transitions with CK transitions.